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分析下圖所示的組合邏輯電路
1.畫出輸出F對(duì)輸入Z的定時(shí)關(guān)系圖（假定輸入X和Y都保持高電平，且每個(gè)門電路都有一個(gè)單位時(shí)間的延遲）； 
2.判定該電路是否存在有靜態(tài)冒險(xiǎn)問(wèn)題，如果存在靜態(tài)冒險(xiǎn)，請(qǐng)消除它。

分析下圖所示的同步時(shí)序電路
1）寫出觸發(fā)器的輸入激勵(lì)表達(dá)式，輸出表達(dá)式和狀態(tài)轉(zhuǎn)換表（或狀態(tài)轉(zhuǎn)換圖）； 
2）說(shuō)明該電路實(shí)現(xiàn)什么功能？